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虽然DDR-SDRAM在体系结构上类似于SDRAM，但还是存在两个主要差别：

DDR-SDRAM比SDRAM拥有更高级的同步电路。

DDR-SDRAM采用一种延迟锁定环路（DLL）来提供数据选通信号以使数据在SDRAM管脚上有效。控制器使用数据选通信号（每16个输出有一个选通信号），来对数据进行更为精确的定位、以及对来自于不同DIMM的输入数据进行再同步。

DDR内存模块的规范由JEDEC开发和批准。JEDEC是电子工业联合会（EIA）的半导体标准化组织。有大约350家业内各个领域的成员公司，积极参与标准开发来满足行业的各种需要。

JEDEC200/266/333MHzDDR规范

184-管脚DIMM,ECC或非ECC

200-管脚SODIMM,ECC或非ECC

172-管脚微型DIMM,非ECC

2.5伏

SSTL-2I/O接口

CAS等待时间:PC1600/2100为2,2.5,PC2700为2.5

支持串行存在监测(SPD)

支持内存芯片堆栈